5-Gbit/s 0.18-μm CMOS单片集成低功耗时钟恢复电路设计(英文)

被引：0

作者：

张长春 ^{[1
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王志功 ^{[1
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施思 ^{[1
]}

潘海仙 ^{[2
]}

郭宇峰 ^{[1
]}

黄继伟 ^{[1
]}

机构：

[1] 东南大学射频与光电集成电路研究所

[2] 不详

来源：

Journal of Southeast University(English Edition) | 2011年 / 27卷 / 02期

关键词：

时钟恢复; 鉴频鉴相器; 压控振荡器; 相位噪声;

D O I：

暂无

中图分类号：

TN432 [场效应型];

学科分类号：

摘要：

为了使一个10Gbit/s2∶1半速率复接器电路能够在无外部提供时钟的环境中工作,需要一个5Gbit/s时钟恢复电路从一路输入数据中提取出所需时钟.该时钟恢复电路采用3级环形压控振荡器,以克服2级振荡器存在的起振不可靠和4级振荡器振荡频率低的问题;采用鉴频鉴相器来增加牵引范围,以适应由于工艺、电压及温度偏差等原因而导致的压控振荡器的宽调谐范围;采用SMIC 0.18-μm CMOS工艺,核心电路面积为170μm×270μm.测试表明:在1.8V电压下,该电路功耗大约为90mW,输入灵敏度低于25mV,输出摆幅大于300mV,且具有-114dBc/Hz@1MHz的相位噪声和1GHz牵引范围.

引用

页码：136 / 139

页数：4

共 3 条

[1] 2.5Gb/s 0.18μm CMOS时钟数据恢复电路(英文)
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王欢
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冯军
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